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Se encontraron 110737 resultados en recursos

Exclusivo BibloRed

Por: Virtual Pro | Fecha: 2020

A continuaci?n se presenta la teor?a asociada a Mol?culas y Luz, con el objetivo de que el estudiante sea capaz de explicar el comportamiento espec?fico de un tipo de mol?culas expuestas a la? luz en distintas longitudes de onda.

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Por: Virtual Pro | Fecha: 2020

La siguiente infograf?a muestra los principios generales sobre el proceso de extrusi?n de pol?meros.

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Por: Universidad del Valle | Fecha: 2020

Se presenta una nueva aplicaciòn basada en un pirómetro a baja radiación para medir la temperatura del cuerpo humano. El instrumento se basa en una termopila de bajo costo como detector y un sistema óptico consistente en un espejo cóncavo elíptico. Fue especialmente diseñado para medir la temperatura de la frente de una persona. El instrumento ha sido caracterizado usando un cuerpo negro construido para este propósito. La precisión del instrumento es de 0.19°C.

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Por: Hindawi Publishing Corporation | Fecha: 2012

La criptografía de curva elíptica (ECC) se ha convertido en un estándar popular de criptografía de clave pública. La seguridad de ECC se debe a la dificultad de resolver el problema del logaritmo discreto de la curva elíptica (ECDLP). En este documento, demostramos un ataque exitoso a ECC sobre un campo primo utilizando el algoritmo de Pollard rho implementado en una plataforma cointegrada de hardware-software. Proponemos una arquitectura de alto rendimiento para la multiplicación sobre un campo primo utilizando bloques DSP especializados en la FPGA. Caracterizamos esta arquitectura explorando el espacio de diseño para determinar la base entera óptima para la representación polinómica y demostramos un mapeo eficiente de este diseño a múltiples curvas elípticas de campo primo estándar. Utilizamos el multiplicador modular resultante para demostrar multiplicaciones de baja latencia para las curvas secp112r1 y P-192. Aplicamos nuestro multiplicador modular para implementar un ataque completo a secp112r1

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Por: Hindawi Publishing Corporation | Fecha: 2011

Presentamos un enfoque altamente productivo para el diseño de hardware basado en una plantilla microarquitectónica de muchos núcleos utilizada para implementar aplicaciones con carga computacional expresadas en un lenguaje de programación de alto nivel y paralelismo de datos, como OpenCL. La plantilla se personaliza en función de cada aplicación a través de una serie de parámetros de alto nivel, como la topología de interconexión o la arquitectura de los elementos de procesamiento. Los principales beneficios de este enfoque son que (i) permite a los programadores expresar el paralelismo a través de una API definida en un lenguaje de programación de alto nivel, (ii) soporta la multitarea de grano grueso y de grano fino al tiempo que permite el control de recursos a nivel de bits, y (iii) reduce el esfuerzo necesario para adaptar el sistema a diferentes algoritmos o aplicaciones diferentes. Comparamos el diseño basado en plantillas tanto con enfoques totalmente personalizados como programables mediante el estudio de implementaciones de un algoritmo de inferencia de gráficos

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Por: Hindawi Publishing Corporation | Fecha: 2012

Este trabajo describe una metodología para modelar el consumo de energía de módulos lógicos. Se presenta un modelo matemático detallado e incorporado en una herramienta para la traducción de modelos escritos en VHDL a SystemC. La funcionalidad para el monitoreo y estimación implícitos de la energía se inserta en la traducción del módulo. La traducción implementa además un enfoque para envolver interfaces RTL a TLM para que el módulo traducido pueda conectarse a un simulador a nivel de sistema. El análisis de energía se basa en un modelo estadístico de la estructura de hardware subyacente y un análisis de los datos de entrada. Se aprovecha la flexibilidad de la sintaxis de C++ para integrar la técnica de evaluación de energía. La precisión y la aceleración del enfoque se ilustran y se comparan con un flujo de análisis de energía convencional utilizando simulación PPR, basada en la tecnología de Xilinx.

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Por: Hindawi Publishing Corporation | Fecha: 2012

La estimación de movimiento es el módulo más complejo en un codificador de video que requiere un alto rendimiento de procesamiento y un ancho de banda de memoria elevado, principalmente cuando se trata de videos de alta definición. El problema de rendimiento puede resolverse aumentando el paralelismo en las operaciones internas. El ancho de banda de memoria externa puede reducirse utilizando una jerarquía de memoria. Este trabajo presenta un modelo de jerarquía de memoria para un núcleo de estimación de movimiento de búsqueda completa. El modelo de jerarquía de memoria propuesto se basa en un esquema de reutilización de datos considerando las características del algoritmo de búsqueda completa. La jerarquía de memoria propuesta reduce significativamente el ancho de banda de memoria externa requerido para el proceso de estimación de movimiento y proporciona un rendimiento de datos muy alto para el núcleo de ME. Este rendimiento es necesario para lograr tiempo real al procesar videos de alta definición. Al considerar el peor escenario de ancho de banda, esta jerarquía de memoria es capaz de redu

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Por: Hindawi Publishing Corporation | Fecha: 2012

Se presenta una arquitectura de enrutador híbrido para Redes en Chip (NoC, por sus siglas en inglés), que combina la conmutación de circuitos basada en Multiplexación por División Espacial (SDM, por sus siglas en inglés) y la conmutación de paquetes para manejar de manera eficiente y por separado el tráfico de streaming y el tráfico de mejor esfuerzo generado en aplicaciones en tiempo real. Además, la técnica SDM se combina con la técnica de Multiplexación por División de Tiempo (TDM, por sus siglas en inglés) en la parte de conmutación de circuitos para aumentar la diversidad de rutas, mejorando así el rendimiento al compartir recursos de comunicación entre múltiples conexiones. La combinación de estas dos técnicas permite mitigar el uso deficiente de recursos inherente a la conmutación de circuitos. De esta manera, se proporciona fácilmente Calidad de Servicio (QoS, por sus siglas en inglés) para el tráfico de streaming a través del subenrutador conmutado por circuitos

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Por: Hindawi Publishing Corporation | Fecha: 2012

Las arquitecturas reconfigurables masivamente paralelas, que ofrecen un gran paralelismo junto con la capacidad de someterse a reconfiguración en tiempo de ejecución, están ganando atención para cumplir con las crecientes demandas computacionales de los sistemas embebidos de alto rendimiento. Proponemos que el lenguaje se utilice para la programación de la categoría de arquitecturas reconfigurables masivamente paralelas. Las propiedades destacadas del lenguaje son la concurrencia explícita con mecanismos integrados para la comunicación entre procesadores, la capacidad para expresar el paralelismo dinámico, el soporte para la expresión de reconfiguraciones dinámicas y atributos de ubicación. Para evaluar el enfoque de programación, se amplió un marco de compilador para admitir las extensiones del lenguaje en el lenguaje y se desarrolló un backend para apuntar al conjunto de procesadores de Ambric. Presentamos dos estudios de caso: la implementación de DCT aprovechando la característica de reconfigurabilidad y un cál

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Por: Hindawi Publishing Corporation | Fecha: 2012

Proponemos un diseño de FPGA para la parte de cálculo de relevancia de una aplicación de búsqueda en tiempo real de alto rendimiento. La aplicación empareja términos en un flujo de documentos con un perfil estático, almacenado en memoria externa. Presentamos un análisis matemático del rendimiento de la aplicación y lo aplicamos al problema de escalar el filtro de Bloom utilizado para descartar no coincidencias.

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